Ανάπτυξη αρχιτεκτονικών υλικού για αναγνώριση ακμών σε εικόνες με τεχνικές σύνθεσης υψηλού επιπέδου (High level synthesis)
Εφαρμογές με υψηλές υπολογιστικές απαιτήσεις, όπως για παράδειγμα αλγόριθμοι μηχανικής όρασης, απαιτούν επιδόσεις που δεν μπορούν να ικανοποιηθούν από ηλεκτρονικούς υπολογιστές χαμηλού κόστους καθώς απαιτούν σημαντικό υπολογιστικό φόρτο, εξαιτίας της αυξημένης πολυπλοκότητάς τους αλλά και του όγκου...
Κύριος συγγραφέας: | |
---|---|
Άλλοι συγγραφείς: | |
Μορφή: | Thesis |
Γλώσσα: | Greek |
Έκδοση: |
2018
|
Θέματα: | |
Διαθέσιμο Online: | http://hdl.handle.net/10889/10962 |
id |
nemertes-10889-10962 |
---|---|
record_format |
dspace |
spelling |
nemertes-10889-109622022-09-05T14:10:26Z Ανάπτυξη αρχιτεκτονικών υλικού για αναγνώριση ακμών σε εικόνες με τεχνικές σύνθεσης υψηλού επιπέδου (High level synthesis) Hardware architecture development for edge detection on images using High Level Synthesis (HLS) Νικολακάκης, Χρήστος-Αλέξανδρος Παλιουράς, Βασίλειος Δερματάς, Ευάγγελος Nikolakakis, Christos-Alexandros Σύνθεση υψηλού επιπέδου Ανίχνευση ακμών FPGA High level synthesis Edge detection Canny edge detectors Vivado HLS Zynq7000 APSoC HLS ARM 621.395 Εφαρμογές με υψηλές υπολογιστικές απαιτήσεις, όπως για παράδειγμα αλγόριθμοι μηχανικής όρασης, απαιτούν επιδόσεις που δεν μπορούν να ικανοποιηθούν από ηλεκτρονικούς υπολογιστές χαμηλού κόστους καθώς απαιτούν σημαντικό υπολογιστικό φόρτο, εξαιτίας της αυξημένης πολυπλοκότητάς τους αλλά και του όγκου των δεδομένων που χρησιμοποιούν. Για το λόγο αυτό η υλοποίησή τους πραγματοποιείται σε υλικό ειδικού σκοπού, όπως για παράδειγμα σε application-specific integrated circuits (ASIC)s ή se Field Programmable Gate Array circuits (FPGA). Η υλοποίηση σε εξειδικευμένο υλικό απαιτεί την απασχόληση πολυπληθούς και ιδιαίτερα εξειδικευμένου προσωπικού καθώς και μεγάλο χρόνο ανάπτυξης. Για το λόγο αυτό είναι απαραίτητο οι διαδικασίες υλοποίησής τους αφενός να συντομευτούν πολύ, αφετέρου να μειωθεί το κόστος ανάπτυξής τους. Σκοπός της παρούσας διπλωματικής εργασίας είναι η ανάπτυξη ενός συνδυασμένου συστήματος hardware/software και η υλοποίηση ενός ενσωματωμένου συστήματος για την υλοποίηση ενός τέτοιου απαιτητικού αλγορίθμου, συγκεκριμένα του Canny Edge Detector. Σε αντίθεση με το συνηθισμένο τρόπο αντιμετώπισης σχεδιασμού σε FPGA, θα αναπτύξουμε τον αλγόριθμο με τη βοήθεια του εργαλείου Vivado High-level Synthesis (HLS) της Xilinx, το οποίο μετασχηματίζει μία περιγραφή από γλώσσα γενικού σκοπού, υψηλού επιπέδου όπως η C σε μία περιγραφή υλικού (RTL). Εκμεταλλευόμενοι τις δυνατότητες βελτιστοποίησης του Vivado HLS και γενικότερα της πλατφόρμας Vivado, μπορούμε να ελαχιστοποιήσουμε κατά πολύ το χρόνο ανάπτυξης και αποσφαλμάτωσης του αλγορίθμου μας και της υλοποίησης του συστήματος. Η συσκευή που χρησιμοποιήθηκε είναι το σύστημα ανάπτυξης της εταιρείας Xilinx, ZC702 με τον Zynq-7000 All Programmable SoC. High computational applications, like algorithms of Computer Vision, require a lot of performance that cannot be provided by low cost personal computers. Such applications, due to their high complexity and the size of the data they process, put a significant strain on the computing infrastracture executing them. Therefore, they are mainly implemented on application-specific integrated circuits (ASIC) or Field Programmable Gate Array Circuits (FPGA). Their implementation requires a large amount of highly trained engineers and large amount of time. However, both the cost and the duration of their implementation must be minimized. In this diploma thesis, we focus on providing a hardware/software design and an embedded system that implements a resource hungry Computer Vision algorithm: Canny Edge Detector. Comparing to the usual way of dealing with the implementation of such algorithms we chose to go with Xilinx's Vivado High-Level Synthesis (HLS). After developing the algorithm in a high-level programming language, for example C/C++, HLS synthesizes it and produces a RTL hardware design. Taking advantage of HLS' optimizations and Xilinx's Vivado platform we observe that the development, debugging, and implementation times can be significantly reducded. The development board used in this thesis is the ZC702 that features a Zynq-7000 All Programmable SoC produced by Xilinx. 2018-01-17T07:04:45Z 2018-01-17T07:04:45Z 2017-10-18 Thesis http://hdl.handle.net/10889/10962 gr 0 application/pdf |
institution |
UPatras |
collection |
Nemertes |
language |
Greek |
topic |
Σύνθεση υψηλού επιπέδου Ανίχνευση ακμών FPGA High level synthesis Edge detection Canny edge detectors Vivado HLS Zynq7000 APSoC HLS ARM 621.395 |
spellingShingle |
Σύνθεση υψηλού επιπέδου Ανίχνευση ακμών FPGA High level synthesis Edge detection Canny edge detectors Vivado HLS Zynq7000 APSoC HLS ARM 621.395 Νικολακάκης, Χρήστος-Αλέξανδρος Ανάπτυξη αρχιτεκτονικών υλικού για αναγνώριση ακμών σε εικόνες με τεχνικές σύνθεσης υψηλού επιπέδου (High level synthesis) |
description |
Εφαρμογές με υψηλές υπολογιστικές απαιτήσεις, όπως για παράδειγμα αλγόριθμοι μηχανικής όρασης, απαιτούν επιδόσεις που δεν μπορούν να ικανοποιηθούν από ηλεκτρονικούς υπολογιστές χαμηλού κόστους καθώς απαιτούν σημαντικό υπολογιστικό φόρτο, εξαιτίας της αυξημένης πολυπλοκότητάς τους αλλά και του όγκου των δεδομένων που χρησιμοποιούν. Για το λόγο αυτό η υλοποίησή τους πραγματοποιείται σε υλικό ειδικού σκοπού, όπως για παράδειγμα σε application-specific integrated circuits (ASIC)s ή se Field Programmable Gate Array circuits (FPGA).
Η υλοποίηση σε εξειδικευμένο υλικό απαιτεί την απασχόληση πολυπληθούς και ιδιαίτερα εξειδικευμένου προσωπικού καθώς και μεγάλο χρόνο ανάπτυξης. Για το λόγο αυτό είναι απαραίτητο οι διαδικασίες υλοποίησής τους αφενός να συντομευτούν πολύ, αφετέρου να μειωθεί το κόστος ανάπτυξής τους. Σκοπός της παρούσας διπλωματικής εργασίας είναι η ανάπτυξη ενός συνδυασμένου συστήματος hardware/software και η υλοποίηση ενός ενσωματωμένου συστήματος για την υλοποίηση ενός τέτοιου απαιτητικού αλγορίθμου, συγκεκριμένα του Canny Edge Detector. Σε αντίθεση με το συνηθισμένο τρόπο αντιμετώπισης σχεδιασμού σε FPGA, θα αναπτύξουμε τον αλγόριθμο με τη βοήθεια του εργαλείου Vivado High-level Synthesis (HLS) της Xilinx, το οποίο μετασχηματίζει μία περιγραφή από γλώσσα γενικού σκοπού, υψηλού επιπέδου όπως η C σε μία περιγραφή υλικού (RTL).
Εκμεταλλευόμενοι τις δυνατότητες βελτιστοποίησης του Vivado HLS και γενικότερα της πλατφόρμας Vivado, μπορούμε να ελαχιστοποιήσουμε κατά πολύ το χρόνο ανάπτυξης και αποσφαλμάτωσης του αλγορίθμου μας και της υλοποίησης του συστήματος. Η συσκευή που χρησιμοποιήθηκε είναι το σύστημα ανάπτυξης της εταιρείας Xilinx, ZC702 με τον Zynq-7000 All Programmable SoC. |
author2 |
Παλιουράς, Βασίλειος |
author_facet |
Παλιουράς, Βασίλειος Νικολακάκης, Χρήστος-Αλέξανδρος |
format |
Thesis |
author |
Νικολακάκης, Χρήστος-Αλέξανδρος |
author_sort |
Νικολακάκης, Χρήστος-Αλέξανδρος |
title |
Ανάπτυξη αρχιτεκτονικών υλικού για αναγνώριση ακμών σε εικόνες με τεχνικές σύνθεσης υψηλού επιπέδου (High level synthesis) |
title_short |
Ανάπτυξη αρχιτεκτονικών υλικού για αναγνώριση ακμών σε εικόνες με τεχνικές σύνθεσης υψηλού επιπέδου (High level synthesis) |
title_full |
Ανάπτυξη αρχιτεκτονικών υλικού για αναγνώριση ακμών σε εικόνες με τεχνικές σύνθεσης υψηλού επιπέδου (High level synthesis) |
title_fullStr |
Ανάπτυξη αρχιτεκτονικών υλικού για αναγνώριση ακμών σε εικόνες με τεχνικές σύνθεσης υψηλού επιπέδου (High level synthesis) |
title_full_unstemmed |
Ανάπτυξη αρχιτεκτονικών υλικού για αναγνώριση ακμών σε εικόνες με τεχνικές σύνθεσης υψηλού επιπέδου (High level synthesis) |
title_sort |
ανάπτυξη αρχιτεκτονικών υλικού για αναγνώριση ακμών σε εικόνες με τεχνικές σύνθεσης υψηλού επιπέδου (high level synthesis) |
publishDate |
2018 |
url |
http://hdl.handle.net/10889/10962 |
work_keys_str_mv |
AT nikolakakēschrēstosalexandros anaptyxēarchitektonikōnylikougiaanagnōrisēakmōnseeikonesmetechnikessynthesēsypsēlouepipedouhighlevelsynthesis AT nikolakakēschrēstosalexandros hardwarearchitecturedevelopmentforedgedetectiononimagesusinghighlevelsynthesishls |
_version_ |
1771297233504829440 |